addc_32.v

`timescale 1ns / 1ps
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// Company: 
// Engineer: 
// 
// Create Date:    21:24:20 02/26/2014 
// Design Name: 
// Module Name:    add_32 
// Project Name: 
// Target Devices: 
// Tool versions: 
// Description: 
//
// Dependencies: 
//
// Revision: 
// Revision 0.01 - File Created
// Additional Comments: 
//
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module ADC32(input [31:0] A, 	//带进位的32位加减器，考虑无符号数兼容。在设计ALU的slt指令上有区别
				 input [31:0] B, 
				 input C0,			//最低进位输入
				 output [32:0] S,
				 output overflow
				  );
	wire [31:0] T;
	assign T = A[30:0] + B[30:0] + C0;
	assign S = A + B + C0;
	assign overflow = S[32] ^ T[31]; // 头二位（31，30）的进位异或结果即是有符号数溢出的标记

endmodule